Classic Timing Analyzer report for lock Fri May 18 08:23:38 2018 Quartus II Version 9.0 Build 132 02/25/2009 SJ Full Version --------------------- ; Table of Contents ; --------------------- 1. Legal Notice 2. Timing Analyzer Summary 3. Timing Analyzer Settings 4. Clock Settings Summary 5. Clock Setup: 'clk' 6. tsu 7. tco 8. th 9. Timing Analyzer Messages ---------------- ; Legal Notice ; ---------------- Copyright (C) 1991-2009 Altera Corporation Your use of Altera Corporation's design tools, logic functions and other software and tools, and its AMPP partner logic functions, and any output files from any of the foregoing (including device programming or simulation files), and any associated documentation or information are expressly subject to the terms and conditions of the Altera Program License Subscription Agreement, Altera MegaCore Function License Agreement, or other applicable license agreement, including, without limitation, that your use is for the sole purpose of programming logic devices manufactured by Altera and sold by Altera or its authorized distributors. Please refer to the applicable agreement for further details. +---------------------------------------------------------------------------------------------------------------------------------------------------------+ ; Timing Analyzer Summary ; +------------------------------+-------+---------------+----------------------------------+------------+-----------+------------+----------+--------------+ ; Type ; Slack ; Required Time ; Actual Time ; From ; To ; From Clock ; To Clock ; Failed Paths ; +------------------------------+-------+---------------+----------------------------------+------------+-----------+------------+----------+--------------+ ; Worst-case tsu ; N/A ; None ; 9.548 ns ; code[3] ; cnt[28] ; -- ; clk ; 0 ; ; Worst-case tco ; N/A ; None ; 8.526 ns ; alarm~reg0 ; alarm ; clk ; -- ; 0 ; ; Worst-case th ; N/A ; None ; -1.356 ns ; code[0] ; pwd[0][0] ; -- ; clk ; 0 ; ; Clock Setup: 'clk' ; N/A ; None ; 83.69 MHz ( period = 11.949 ns ) ; cnt[8] ; state[0] ; clk ; clk ; 0 ; ; Total number of failed paths ; ; ; ; ; ; ; ; 0 ; +------------------------------+-------+---------------+----------------------------------+------------+-----------+------------+----------+--------------+ +--------------------------------------------------------------------------------------------------------------------+ ; Timing Analyzer Settings ; +---------------------------------------------------------------------+--------------------+------+----+-------------+ ; Option ; Setting ; From ; To ; Entity Name ; +---------------------------------------------------------------------+--------------------+------+----+-------------+ ; Device Name ; EPM240T100C5 ; ; ; ; ; Timing Models ; Final ; ; ; ; ; Default hold multicycle ; Same as Multicycle ; ; ; ; ; Cut paths between unrelated clock domains ; On ; ; ; ; ; Cut off read during write signal paths ; On ; ; ; ; ; Cut off feedback from I/O pins ; On ; ; ; ; ; Report Combined Fast/Slow Timing ; Off ; ; ; ; ; Ignore Clock Settings ; Off ; ; ; ; ; Analyze latches as synchronous elements ; On ; ; ; ; ; Enable Recovery/Removal analysis ; Off ; ; ; ; ; Enable Clock Latency ; Off ; ; ; ; ; Use TimeQuest Timing Analyzer ; Off ; ; ; ; ; Minimum Core Junction Temperature ; 0 ; ; ; ; ; Maximum Core Junction Temperature ; 85 ; ; ; ; ; Number of source nodes to report per destination node ; 10 ; ; ; ; ; Number of destination nodes to report ; 10 ; ; ; ; ; Number of paths to report ; 200 ; ; ; ; ; Report Minimum Timing Checks ; Off ; ; ; ; ; Use Fast Timing Models ; Off ; ; ; ; ; Report IO Paths Separately ; Off ; ; ; ; ; Perform Multicorner Analysis ; Off ; ; ; ; ; Reports the worst-case path for each clock domain and analysis ; Off ; ; ; ; ; Removes common clock path pessimism (CCPP) during slack computation ; Off ; ; ; ; ; Output I/O Timing Endpoint ; Near End ; ; ; ; +---------------------------------------------------------------------+--------------------+------+----+-------------+ +------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+ ; Clock Settings Summary ; +-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+ ; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ; +-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+ ; clk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ; +-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+ +---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+ ; Clock Setup: 'clk' ; +-----------------------------------------+-----------------------------------------------------+----------+----------+------------+----------+-----------------------------+---------------------------+-------------------------+ ; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ; +-----------------------------------------+-----------------------------------------------------+----------+----------+------------+----------+-----------------------------+---------------------------+-------------------------+ ; N/A ; 83.69 MHz ( period = 11.949 ns ) ; cnt[8] ; state[1] ; clk ; clk ; None ; None ; 11.240 ns ; ; N/A ; 83.69 MHz ( period = 11.949 ns ) ; cnt[8] ; state[2] ; clk ; clk ; None ; None ; 11.240 ns ; ; N/A ; 83.69 MHz ( period = 11.949 ns ) ; cnt[8] ; state[0] ; clk ; clk ; None ; None ; 11.240 ns ; ; N/A ; 84.10 MHz ( period = 11.891 ns ) ; cnt[8] ; cnt[31] ; clk ; clk ; None ; None ; 11.182 ns ; ; N/A ; 84.10 MHz ( period = 11.891 ns ) ; cnt[8] ; cnt[26] ; clk ; clk ; None ; None ; 11.182 ns ; ; N/A ; 84.10 MHz ( period = 11.891 ns ) ; cnt[8] ; cnt[27] ; clk ; clk ; None ; None ; 11.182 ns ; ; N/A ; 84.10 MHz ( period = 11.891 ns ) ; cnt[8] ; cnt[30] ; clk ; clk ; None ; None ; 11.182 ns ; ; N/A ; 84.10 MHz ( period = 11.891 ns ) ; cnt[8] ; cnt[29] ; clk ; clk ; None ; None ; 11.182 ns ; ; N/A ; 84.10 MHz ( period = 11.891 ns ) ; cnt[8] ; cnt[28] ; clk ; clk ; None ; None ; 11.182 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[16] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[17] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[18] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[19] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[20] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[21] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[22] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[23] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[24] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.15 MHz ( period = 11.883 ns ) ; cnt[8] ; cnt[25] ; clk ; clk ; None ; None ; 11.174 ns ; ; N/A ; 84.18 MHz ( period = 11.879 ns ) ; cnt[25] ; state[1] ; clk ; clk ; None ; None ; 11.170 ns ; ; N/A ; 84.18 MHz ( period = 11.879 ns ) ; cnt[25] ; state[2] ; clk ; clk ; None ; None ; 11.170 ns ; ; N/A ; 84.18 MHz ( period = 11.879 ns ) ; cnt[25] ; state[0] ; clk ; clk ; None ; None ; 11.170 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[6] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[7] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[8] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[9] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[10] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[11] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[12] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[13] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[14] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.22 MHz ( period = 11.874 ns ) ; cnt[8] ; cnt[15] ; clk ; clk ; None ; None ; 11.165 ns ; ; N/A ; 84.32 MHz ( period = 11.860 ns ) ; cnt[7] ; state[1] ; clk ; clk ; None ; None ; 11.151 ns ; ; N/A ; 84.32 MHz ( period = 11.860 ns ) ; cnt[7] ; state[2] ; clk ; clk ; None ; None ; 11.151 ns ; ; N/A ; 84.32 MHz ( period = 11.860 ns ) ; cnt[7] ; state[0] ; clk ; clk ; None ; None ; 11.151 ns ; ; N/A ; 84.60 MHz ( period = 11.821 ns ) ; cnt[25] ; cnt[31] ; clk ; clk ; None ; None ; 11.112 ns ; ; N/A ; 84.60 MHz ( period = 11.821 ns ) ; cnt[25] ; cnt[26] ; clk ; clk ; None ; None ; 11.112 ns ; ; N/A ; 84.60 MHz ( period = 11.821 ns ) ; cnt[25] ; cnt[27] ; clk ; clk ; None ; None ; 11.112 ns ; ; N/A ; 84.60 MHz ( period = 11.821 ns ) ; cnt[25] ; cnt[30] ; clk ; clk ; None ; None ; 11.112 ns ; ; N/A ; 84.60 MHz ( period = 11.821 ns ) ; cnt[25] ; cnt[29] ; clk ; clk ; None ; None ; 11.112 ns ; ; N/A ; 84.60 MHz ( period = 11.821 ns ) ; cnt[25] ; cnt[28] ; clk ; clk ; None ; None ; 11.112 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[16] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[17] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[18] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[19] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[20] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[21] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[22] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[23] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[24] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.65 MHz ( period = 11.813 ns ) ; cnt[25] ; cnt[25] ; clk ; clk ; None ; None ; 11.104 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[6] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[7] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[8] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[9] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[10] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[11] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[12] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[13] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[14] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.72 MHz ( period = 11.804 ns ) ; cnt[25] ; cnt[15] ; clk ; clk ; None ; None ; 11.095 ns ; ; N/A ; 84.73 MHz ( period = 11.802 ns ) ; cnt[7] ; cnt[31] ; clk ; clk ; None ; None ; 11.093 ns ; ; N/A ; 84.73 MHz ( period = 11.802 ns ) ; cnt[7] ; cnt[26] ; clk ; clk ; None ; None ; 11.093 ns ; ; N/A ; 84.73 MHz ( period = 11.802 ns ) ; cnt[7] ; cnt[27] ; clk ; clk ; None ; None ; 11.093 ns ; ; N/A ; 84.73 MHz ( period = 11.802 ns ) ; cnt[7] ; cnt[30] ; clk ; clk ; None ; None ; 11.093 ns ; ; N/A ; 84.73 MHz ( period = 11.802 ns ) ; cnt[7] ; cnt[29] ; clk ; clk ; None ; None ; 11.093 ns ; ; N/A ; 84.73 MHz ( period = 11.802 ns ) ; cnt[7] ; cnt[28] ; clk ; clk ; None ; None ; 11.093 ns ; ; N/A ; 84.77 MHz ( period = 11.796 ns ) ; state[0] ; cnt[31] ; clk ; clk ; None ; None ; 11.087 ns ; ; N/A ; 84.77 MHz ( period = 11.796 ns ) ; state[0] ; cnt[26] ; clk ; clk ; None ; None ; 11.087 ns ; ; N/A ; 84.77 MHz ( period = 11.796 ns ) ; state[0] ; cnt[27] ; clk ; clk ; None ; None ; 11.087 ns ; ; N/A ; 84.77 MHz ( period = 11.796 ns ) ; state[0] ; cnt[30] ; clk ; clk ; None ; None ; 11.087 ns ; ; N/A ; 84.77 MHz ( period = 11.796 ns ) ; state[0] ; cnt[29] ; clk ; clk ; None ; None ; 11.087 ns ; ; N/A ; 84.77 MHz ( period = 11.796 ns ) ; state[0] ; cnt[28] ; clk ; clk ; None ; None ; 11.087 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[16] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[17] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[18] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[19] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[20] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[21] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[22] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[23] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[24] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.79 MHz ( period = 11.794 ns ) ; cnt[7] ; cnt[25] ; clk ; clk ; None ; None ; 11.085 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[16] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[17] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[18] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[19] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[20] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[21] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[22] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[23] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[24] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.83 MHz ( period = 11.788 ns ) ; state[0] ; cnt[25] ; clk ; clk ; None ; None ; 11.079 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[6] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[7] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[8] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[9] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[10] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[11] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[12] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[13] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[14] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.85 MHz ( period = 11.785 ns ) ; cnt[7] ; cnt[15] ; clk ; clk ; None ; None ; 11.076 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[6] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[7] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[8] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[9] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[10] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[11] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[12] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[13] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[14] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 84.90 MHz ( period = 11.779 ns ) ; state[0] ; cnt[15] ; clk ; clk ; None ; None ; 11.070 ns ; ; N/A ; 86.25 MHz ( period = 11.594 ns ) ; state[2] ; cnt[31] ; clk ; clk ; None ; None ; 10.885 ns ; ; N/A ; 86.25 MHz ( period = 11.594 ns ) ; state[2] ; cnt[26] ; clk ; clk ; None ; None ; 10.885 ns ; ; N/A ; 86.25 MHz ( period = 11.594 ns ) ; state[2] ; cnt[27] ; clk ; clk ; None ; None ; 10.885 ns ; ; N/A ; 86.25 MHz ( period = 11.594 ns ) ; state[2] ; cnt[30] ; clk ; clk ; None ; None ; 10.885 ns ; ; N/A ; 86.25 MHz ( period = 11.594 ns ) ; state[2] ; cnt[29] ; clk ; clk ; None ; None ; 10.885 ns ; ; N/A ; 86.25 MHz ( period = 11.594 ns ) ; state[2] ; cnt[28] ; clk ; clk ; None ; None ; 10.885 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[16] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[17] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[18] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[19] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[20] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[21] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[22] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[23] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[24] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.31 MHz ( period = 11.586 ns ) ; state[2] ; cnt[25] ; clk ; clk ; None ; None ; 10.877 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[6] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[7] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[8] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[9] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[10] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[11] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[12] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[13] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[14] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.38 MHz ( period = 11.577 ns ) ; state[2] ; cnt[15] ; clk ; clk ; None ; None ; 10.868 ns ; ; N/A ; 86.53 MHz ( period = 11.557 ns ) ; cnt[22] ; state[1] ; clk ; clk ; None ; None ; 10.848 ns ; ; N/A ; 86.53 MHz ( period = 11.557 ns ) ; cnt[22] ; state[2] ; clk ; clk ; None ; None ; 10.848 ns ; ; N/A ; 86.53 MHz ( period = 11.557 ns ) ; cnt[22] ; state[0] ; clk ; clk ; None ; None ; 10.848 ns ; ; N/A ; 86.66 MHz ( period = 11.540 ns ) ; cnt[11] ; state[1] ; clk ; clk ; None ; None ; 10.831 ns ; ; N/A ; 86.66 MHz ( period = 11.540 ns ) ; cnt[11] ; state[2] ; clk ; clk ; None ; None ; 10.831 ns ; ; N/A ; 86.66 MHz ( period = 11.540 ns ) ; cnt[11] ; state[0] ; clk ; clk ; None ; None ; 10.831 ns ; ; N/A ; 86.74 MHz ( period = 11.529 ns ) ; cnt[6] ; state[1] ; clk ; clk ; None ; None ; 10.820 ns ; ; N/A ; 86.74 MHz ( period = 11.529 ns ) ; cnt[6] ; state[2] ; clk ; clk ; None ; None ; 10.820 ns ; ; N/A ; 86.74 MHz ( period = 11.529 ns ) ; cnt[6] ; state[0] ; clk ; clk ; None ; None ; 10.820 ns ; ; N/A ; 86.79 MHz ( period = 11.522 ns ) ; cnt[13] ; state[1] ; clk ; clk ; None ; None ; 10.813 ns ; ; N/A ; 86.79 MHz ( period = 11.522 ns ) ; cnt[13] ; state[2] ; clk ; clk ; None ; None ; 10.813 ns ; ; N/A ; 86.79 MHz ( period = 11.522 ns ) ; cnt[13] ; state[0] ; clk ; clk ; None ; None ; 10.813 ns ; ; N/A ; 86.93 MHz ( period = 11.503 ns ) ; cnt[12] ; state[1] ; clk ; clk ; None ; None ; 10.794 ns ; ; N/A ; 86.93 MHz ( period = 11.503 ns ) ; cnt[12] ; state[2] ; clk ; clk ; None ; None ; 10.794 ns ; ; N/A ; 86.93 MHz ( period = 11.503 ns ) ; cnt[12] ; state[0] ; clk ; clk ; None ; None ; 10.794 ns ; ; N/A ; 86.96 MHz ( period = 11.499 ns ) ; cnt[22] ; cnt[31] ; clk ; clk ; None ; None ; 10.790 ns ; ; N/A ; 86.96 MHz ( period = 11.499 ns ) ; cnt[22] ; cnt[26] ; clk ; clk ; None ; None ; 10.790 ns ; ; N/A ; 86.96 MHz ( period = 11.499 ns ) ; cnt[22] ; cnt[27] ; clk ; clk ; None ; None ; 10.790 ns ; ; N/A ; 86.96 MHz ( period = 11.499 ns ) ; cnt[22] ; cnt[30] ; clk ; clk ; None ; None ; 10.790 ns ; ; N/A ; 86.96 MHz ( period = 11.499 ns ) ; cnt[22] ; cnt[29] ; clk ; clk ; None ; None ; 10.790 ns ; ; N/A ; 86.96 MHz ( period = 11.499 ns ) ; cnt[22] ; cnt[28] ; clk ; clk ; None ; None ; 10.790 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[16] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[17] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[18] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[19] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[20] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[21] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[22] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[23] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[24] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.02 MHz ( period = 11.491 ns ) ; cnt[22] ; cnt[25] ; clk ; clk ; None ; None ; 10.782 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[11] ; cnt[31] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[6] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[7] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[8] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[9] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[10] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[11] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[12] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[13] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[14] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[22] ; cnt[15] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[11] ; cnt[26] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[11] ; cnt[27] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[11] ; cnt[30] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[11] ; cnt[29] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.09 MHz ( period = 11.482 ns ) ; cnt[11] ; cnt[28] ; clk ; clk ; None ; None ; 10.773 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[16] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[17] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[18] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[19] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[20] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[21] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[22] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[23] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[24] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.15 MHz ( period = 11.474 ns ) ; cnt[11] ; cnt[25] ; clk ; clk ; None ; None ; 10.765 ns ; ; N/A ; 87.18 MHz ( period = 11.471 ns ) ; cnt[6] ; cnt[26] ; clk ; clk ; None ; None ; 10.762 ns ; ; N/A ; 87.18 MHz ( period = 11.471 ns ) ; cnt[6] ; cnt[27] ; clk ; clk ; None ; None ; 10.762 ns ; ; N/A ; 87.18 MHz ( period = 11.471 ns ) ; cnt[6] ; cnt[30] ; clk ; clk ; None ; None ; 10.762 ns ; ; N/A ; 87.18 MHz ( period = 11.471 ns ) ; cnt[6] ; cnt[29] ; clk ; clk ; None ; None ; 10.762 ns ; ; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ; +-----------------------------------------+-----------------------------------------------------+----------+----------+------------+----------+-----------------------------+---------------------------+-------------------------+ +----------------------------------------------------------------------------------------------------------------------------------------------+ ; tsu ; +-----------------------------------------+-----------------------------------------------------+------------+---------+------------+----------+ ; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ; +-----------------------------------------+-----------------------------------------------------+------------+---------+------------+----------+ ; N/A ; None ; 9.548 ns ; code[3] ; cnt[31] ; clk ; ; N/A ; None ; 9.548 ns ; code[3] ; cnt[26] ; clk ; ; N/A ; None ; 9.548 ns ; code[3] ; cnt[27] ; clk ; ; N/A ; None ; 9.548 ns ; code[3] ; cnt[30] ; clk ; ; N/A ; None ; 9.548 ns ; code[3] ; cnt[29] ; clk ; ; N/A ; None ; 9.548 ns ; code[3] ; cnt[28] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[16] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[17] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[18] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[19] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[20] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[21] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[22] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[23] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[24] ; clk ; ; N/A ; None ; 9.540 ns ; code[3] ; cnt[25] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[6] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[7] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[8] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[9] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[10] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[11] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[12] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[13] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[14] ; clk ; ; N/A ; None ; 9.531 ns ; code[3] ; cnt[15] ; clk ; ; N/A ; None ; 9.471 ns ; code[2] ; cnt[31] ; clk ; ; N/A ; None ; 9.471 ns ; code[2] ; cnt[26] ; clk ; ; N/A ; None ; 9.471 ns ; code[2] ; cnt[27] ; clk ; ; N/A ; None ; 9.471 ns ; code[2] ; cnt[30] ; clk ; ; N/A ; None ; 9.471 ns ; code[2] ; cnt[29] ; clk ; ; N/A ; None ; 9.471 ns ; code[2] ; cnt[28] ; clk ; ; N/A ; None ; 9.430 ns ; code[1] ; cnt[31] ; clk ; ; N/A ; None ; 9.430 ns ; code[1] ; cnt[26] ; clk ; ; N/A ; None ; 9.430 ns ; code[1] ; cnt[27] ; clk ; ; N/A ; None ; 9.430 ns ; code[1] ; cnt[30] ; clk ; ; N/A ; None ; 9.430 ns ; code[1] ; cnt[29] ; clk ; ; N/A ; None ; 9.430 ns ; code[1] ; cnt[28] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[16] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[17] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[18] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[19] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[20] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[21] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[22] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[23] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[24] ; clk ; ; N/A ; None ; 9.422 ns ; code[1] ; cnt[25] ; clk ; ; N/A ; None ; 9.413 ns ; code[1] ; cnt[6] ; clk ; ; N/A ; None ; 9.413 ns ; code[1] ; cnt[7] ; clk ; ; N/A ; None ; 9.413 ns ; code[1] ; cnt[8] ; clk ; ; N/A ; None ; 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; N/A ; None ; 8.315 ns ; mode[1] ; cnt[25] ; clk ; ; N/A ; None ; 8.295 ns ; mode[0] ; pwd[0][1] ; clk ; ; N/A ; None ; 8.295 ns ; mode[0] ; pwd[0][2] ; clk ; ; N/A ; None ; 8.273 ns ; mode[0] ; pwd[1][3] ; clk ; ; N/A ; None ; 8.273 ns ; mode[0] ; pwd[1][31] ; clk ; ; N/A ; None ; 8.271 ns ; mode[1] ; cnt[1] ; clk ; ; N/A ; None ; 8.271 ns ; mode[1] ; cnt[2] ; clk ; ; N/A ; None ; 8.271 ns ; mode[1] ; cnt[0] ; clk ; ; N/A ; None ; 8.271 ns ; mode[1] ; cnt[3] ; clk ; ; N/A ; None ; 8.271 ns ; mode[1] ; cnt[4] ; clk ; ; N/A ; None ; 8.271 ns ; mode[1] ; cnt[5] ; clk ; ; N/A ; None ; 8.270 ns ; mode[0] ; pwd[1][1] ; clk ; ; N/A ; None ; 8.270 ns ; mode[0] ; pwd[1][0] ; clk ; ; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; +-----------------------------------------+-----------------------------------------------------+------------+---------+------------+----------+ +-----------------------------------------------------------------------+ ; tco ; +-------+--------------+------------+-------------+--------+------------+ ; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ; +-------+--------------+------------+-------------+--------+------------+ ; N/A ; None ; 8.526 ns ; alarm~reg0 ; alarm ; clk ; ; N/A ; None ; 8.010 ns ; unlock~reg0 ; unlock ; clk ; ; N/A ; None ; 7.982 ns ; err~reg0 ; err ; clk ; +-------+--------------+------------+-------------+--------+------------+ +----------------------------------------------------------------------------------------------------------------------------------------------+ ; th ; +-----------------------------------------+-----------------------------------------------------+-----------+---------+-------------+----------+ ; Minimum Slack ; Required th ; Actual th ; From ; To ; To Clock ; +-----------------------------------------+-----------------------------------------------------+-----------+---------+-------------+----------+ ; N/A ; None ; -1.356 ns ; code[0] ; pwd[0][0] ; clk ; ; N/A ; None ; -1.466 ns ; code[1] ; pwd[3][1] ; clk ; ; N/A ; None ; -1.484 ns ; code[3] ; pwd[0][3] ; clk ; ; N/A ; None ; -1.484 ns ; code[3] ; pwd[1][3] ; clk ; ; N/A ; None ; -1.511 ns ; code[3] ; pwd[2][3] ; clk ; ; N/A ; None ; -1.587 ns ; code[1] ; pwd[2][1] ; clk ; ; N/A ; None ; -1.747 ns ; code[3] ; pwd[3][3] ; clk ; ; N/A ; None ; -2.283 ns ; mode[1] ; unlock~reg0 ; clk ; ; N/A ; None ; -2.328 ns ; code[0] ; pwd[2][0] ; clk ; ; N/A ; None ; -2.337 ns ; code[0] ; pwd[3][0] ; clk ; ; N/A ; None ; -2.379 ns ; code[1] ; pwd[0][1] ; clk ; ; N/A ; None ; -2.383 ns ; code[0] ; pwd[1][0] ; clk ; ; N/A ; None ; -2.387 ns ; code[1] ; pwd[1][1] ; clk ; ; N/A ; None ; -2.396 ns ; code[2] ; pwd[1][2] ; clk ; ; N/A ; None ; -2.407 ns ; code[2] ; pwd[0][2] ; clk ; ; N/A ; None ; -2.488 ns ; code[2] ; pwd[3][2] ; clk ; ; N/A ; None ; -2.491 ns ; code[2] ; pwd[2][2] ; clk ; ; N/A ; None ; -2.521 ns ; rst ; pwd[3][31] ; clk ; ; N/A ; None ; -2.522 ns ; mode[0] ; unlock~reg0 ; clk ; ; N/A ; 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code[2] ; cnt[5] ; clk ; ; N/A ; None ; -6.779 ns ; mode[1] ; pwd[2][3] ; clk ; ; N/A ; None ; -6.779 ns ; mode[1] ; pwd[2][1] ; clk ; ; N/A ; None ; -6.779 ns ; mode[1] ; pwd[2][31] ; clk ; ; N/A ; None ; -6.779 ns ; mode[1] ; pwd[2][0] ; clk ; ; N/A ; None ; -6.779 ns ; mode[1] ; pwd[2][2] ; clk ; ; N/A ; None ; -6.793 ns ; code[1] ; cnt[1] ; clk ; ; N/A ; None ; -6.793 ns ; code[1] ; cnt[2] ; clk ; ; N/A ; None ; -6.793 ns ; code[1] ; cnt[0] ; clk ; ; N/A ; None ; -6.793 ns ; code[1] ; cnt[3] ; clk ; ; N/A ; None ; -6.793 ns ; code[1] ; cnt[4] ; clk ; ; N/A ; None ; -6.793 ns ; code[1] ; cnt[5] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[16] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[17] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[18] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[19] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[20] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[21] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[22] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[23] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[24] ; clk ; ; N/A ; None ; -6.852 ns ; code[1] ; cnt[25] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[16] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[17] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[18] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[19] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[20] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[21] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[22] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[23] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[24] ; clk ; ; N/A ; None ; -6.853 ns ; code[3] ; cnt[25] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[6] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[7] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[8] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[9] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[10] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[11] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[12] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[13] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[14] ; clk ; ; N/A ; None ; -6.853 ns ; code[1] ; cnt[15] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[6] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[7] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[8] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[9] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[10] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[11] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[12] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[13] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[14] ; clk ; ; N/A ; None ; -6.854 ns ; code[3] ; cnt[15] ; clk ; ; N/A ; None ; -7.018 ns ; mode[0] ; pwd[2][3] ; clk ; ; N/A ; None ; -7.018 ns ; mode[0] ; pwd[2][1] ; clk ; ; N/A ; None ; -7.018 ns ; mode[0] ; pwd[2][31] ; clk ; ; N/A ; None ; -7.018 ns ; mode[0] ; pwd[2][0] ; clk ; ; N/A ; None ; -7.018 ns ; mode[0] ; pwd[2][2] ; clk ; ; N/A ; None ; -7.091 ns ; code[3] ; cnt[31] ; clk ; ; N/A ; None ; -7.091 ns ; code[3] ; cnt[26] ; clk ; ; N/A ; None ; -7.091 ns ; code[3] ; cnt[27] ; clk ; ; N/A ; None ; -7.091 ns ; code[3] ; cnt[30] ; clk ; ; N/A ; None ; -7.091 ns ; code[3] ; cnt[29] ; clk ; ; N/A ; None ; -7.091 ns ; code[3] ; cnt[28] ; clk ; ; N/A ; None ; -7.215 ns ; code[2] ; cnt[6] ; clk ; ; N/A ; None ; -7.215 ns ; code[2] ; cnt[7] ; clk ; ; N/A ; None ; -7.215 ns ; code[2] ; cnt[8] ; clk ; ; N/A ; None ; -7.215 ns ; code[2] ; cnt[9] ; clk ; ; N/A ; None ; -7.215 ns ; code[2] ; cnt[10] ; clk ; ; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; +-----------------------------------------+-----------------------------------------------------+-----------+---------+-------------+----------+ +--------------------------+ ; Timing Analyzer Messages ; +--------------------------+ Info: ******************************************************************* Info: Running Quartus II Classic Timing Analyzer Info: Version 9.0 Build 132 02/25/2009 SJ Full Version Info: Processing started: Fri May 18 08:23:37 2018 Info: Command: quartus_tan --read_settings_files=off --write_settings_files=off lock -c lock Info: Only one processor detected - disabling parallel compilation Info: Started post-fitting delay annotation Info: Delay annotation completed successfully Warning: Found pins functioning as undefined clocks and/or memory enables Info: Assuming node "clk" is an undefined clock Info: Clock "clk" has Internal fmax of 83.69 MHz between source register "cnt[8]" and destination register "state[1]" (period= 11.949 ns) Info: + Longest register to register delay is 11.240 ns Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X5_Y1_N2; Fanout = 5; REG Node = 'cnt[8]' Info: 2: + IC(2.662 ns) + CELL(0.914 ns) = 3.576 ns; Loc. = LC_X2_Y4_N0; Fanout = 1; COMB Node = 'LessThan0~1' Info: 3: + IC(1.960 ns) + CELL(0.200 ns) = 5.736 ns; Loc. = LC_X3_Y1_N8; Fanout = 1; COMB Node = 'LessThan0~4' Info: 4: + IC(0.305 ns) + CELL(0.200 ns) = 6.241 ns; Loc. = LC_X3_Y1_N9; Fanout = 3; COMB Node = 'LessThan0~9' Info: 5: + IC(0.755 ns) + CELL(0.200 ns) = 7.196 ns; Loc. = LC_X3_Y1_N0; Fanout = 2; COMB Node = 'alarm~14' Info: 6: + IC(1.940 ns) + CELL(0.200 ns) = 9.336 ns; Loc. = LC_X4_Y4_N4; Fanout = 3; COMB Node = 'state~222' Info: 7: + IC(0.661 ns) + CELL(1.243 ns) = 11.240 ns; Loc. = LC_X4_Y4_N9; Fanout = 13; REG Node = 'state[1]' Info: Total cell delay = 2.957 ns ( 26.31 % ) Info: Total interconnect delay = 8.283 ns ( 73.69 % ) Info: - Smallest clock skew is 0.000 ns Info: + Shortest clock path from clock "clk" to destination register is 3.348 ns Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 58; CLK Node = 'clk' Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X4_Y4_N9; Fanout = 13; REG Node = 'state[1]' Info: Total cell delay = 2.081 ns ( 62.16 % ) Info: Total interconnect delay = 1.267 ns ( 37.84 % ) Info: - Longest clock path from clock "clk" to source register is 3.348 ns Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 58; CLK Node = 'clk' Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X5_Y1_N2; Fanout = 5; REG Node = 'cnt[8]' Info: Total cell delay = 2.081 ns ( 62.16 % ) Info: Total interconnect delay = 1.267 ns ( 37.84 % ) Info: + Micro clock to output delay of source is 0.376 ns Info: + Micro setup delay of destination is 0.333 ns Info: tsu for register "cnt[31]" (data pin = "code[3]", clock pin = "clk") is 9.548 ns Info: + Longest pin to register delay is 12.563 ns Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_19; Fanout = 9; PIN Node = 'code[3]' Info: 2: + IC(3.345 ns) + CELL(0.200 ns) = 4.677 ns; Loc. = LC_X6_Y3_N7; Fanout = 2; COMB Node = 'Equal9~0' Info: 3: + IC(0.767 ns) + CELL(0.511 ns) = 5.955 ns; Loc. = LC_X6_Y3_N9; Fanout = 4; COMB Node = 'Selector32~0' Info: 4: + IC(2.453 ns) + CELL(0.200 ns) = 8.608 ns; Loc. = LC_X3_Y1_N2; Fanout = 1; COMB Node = 'cnt[16]~418' Info: 5: + IC(0.305 ns) + CELL(0.200 ns) = 9.113 ns; Loc. = LC_X3_Y1_N3; Fanout = 32; COMB Node = 'cnt[16]~420' Info: 6: + IC(1.690 ns) + CELL(1.760 ns) = 12.563 ns; Loc. = LC_X7_Y1_N5; Fanout = 5; REG Node = 'cnt[31]' Info: Total cell delay = 4.003 ns ( 31.86 % ) Info: Total interconnect delay = 8.560 ns ( 68.14 % ) Info: + Micro setup delay of destination is 0.333 ns Info: - Shortest clock path from clock "clk" to destination register is 3.348 ns Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 58; CLK Node = 'clk' Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X7_Y1_N5; Fanout = 5; REG Node = 'cnt[31]' Info: Total cell delay = 2.081 ns ( 62.16 % ) Info: Total interconnect delay = 1.267 ns ( 37.84 % ) Info: tco from clock "clk" to destination pin "alarm" through register "alarm~reg0" is 8.526 ns Info: + Longest clock path from clock "clk" to source register is 3.348 ns Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 58; CLK Node = 'clk' Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X3_Y3_N8; Fanout = 47; REG Node = 'alarm~reg0' Info: Total cell delay = 2.081 ns ( 62.16 % ) Info: Total interconnect delay = 1.267 ns ( 37.84 % ) Info: + Micro clock to output delay of source is 0.376 ns Info: + Longest register to pin delay is 4.802 ns Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X3_Y3_N8; Fanout = 47; REG Node = 'alarm~reg0' Info: 2: + IC(2.480 ns) + CELL(2.322 ns) = 4.802 ns; Loc. = PIN_5; Fanout = 0; PIN Node = 'alarm' Info: Total cell delay = 2.322 ns ( 48.35 % ) Info: Total interconnect delay = 2.480 ns ( 51.65 % ) Info: th for register "pwd[0][0]" (data pin = "code[0]", clock pin = "clk") is -1.356 ns Info: + Longest clock path from clock "clk" to destination register is 3.348 ns Info: 1: + IC(0.000 ns) + CELL(1.163 ns) = 1.163 ns; Loc. = PIN_12; Fanout = 58; CLK Node = 'clk' Info: 2: + IC(1.267 ns) + CELL(0.918 ns) = 3.348 ns; Loc. = LC_X7_Y4_N5; Fanout = 1; REG Node = 'pwd[0][0]' Info: Total cell delay = 2.081 ns ( 62.16 % ) Info: Total interconnect delay = 1.267 ns ( 37.84 % ) Info: + Micro hold delay of destination is 0.221 ns Info: - Shortest pin to register delay is 4.925 ns Info: 1: + IC(0.000 ns) + CELL(1.132 ns) = 1.132 ns; Loc. = PIN_16; Fanout = 9; PIN Node = 'code[0]' Info: 2: + IC(3.202 ns) + CELL(0.591 ns) = 4.925 ns; Loc. = LC_X7_Y4_N5; Fanout = 1; REG Node = 'pwd[0][0]' Info: Total cell delay = 1.723 ns ( 34.98 % ) Info: Total interconnect delay = 3.202 ns ( 65.02 % ) Info: Quartus II Classic Timing Analyzer was successful. 0 errors, 1 warning Info: Peak virtual memory: 231 megabytes Info: Processing ended: Fri May 18 08:23:38 2018 Info: Elapsed time: 00:00:01 Info: Total CPU time (on all processors): 00:00:00